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芯片封装基板设计培训班

   参加对象
       课程面向相关电子信息与集成电路企业(包括集成电路芯片设计公司、电子产品系统厂商、高校及研究院所、高速I/O及IP供应商、IC晶圆代工厂、封装厂以及有关EDA软件公司)的高管、技术主管、I/O设计工程师、电路工程师、信号完整性工程师、系统硬件设计人员、封装设计工程师、芯片功耗与电源完整性、芯片封装协同设计、系统电路设计、ESD/IO设计工程师、电路设计工程师等工程师以及项目主管、业务经理、在校大学生、研究生、研究员、大学教授等,有职业转型规划的封装厂、材料与设备厂的工艺制程技术人员等以及相关行业市场研究人员与VC投资者。
   班级规模及环境--热线:4008699035 手机:15921673576( 微信同号)
       每期人数限3到5人。
   开课时间和上课地点
             上课地点:【上海】:同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【深圳分部】:电影大厦(地铁一号线大剧院站)/深圳大学成教院 【北京分部】:北京中山学院/福鑫大楼 【南京分部】:金港大厦(和燕路) 【武汉分部】:佳源大厦(高新二路) 【成都分部】:领馆区1号(中和大道) 【沈阳分部】:沈阳理工大学/六宅臻品 【郑州分部】:郑州大学/锦华大厦 【石家庄分部】:河北科技大学/瑞景大厦 【广州分部】:广粮大厦 【西安分部】:协同大厦
             最近开课时间(周末班/连续班/晚班):
芯片封装基板设计培训班
开班时间:2020年7月20日
   实验设备和授课方式

     ☆资深工程师授课

        ☆外地学员:代理安排食宿(需提前预定) ☆注重质量 ☆边部分边练

        ☆合格学员免费推荐工作
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   最新优惠
       ☆请咨询客服。
   质量保障

        1、培训过程中,如有部分内容理解不透或消化不好,可免费在以后培训班中重听;
        2、培训结束后,授课老师留给学员联系方式,保障培训效果,免费提供课后技术支持。
        3、培训合格学员可享受免费推荐就业机会。

   课程目标和收获

此精心设计的理论与实践相结合的培训课程,旨在为封装厂、集成电路、芯片设计公司、高校及研究院所、电子产品系统厂商等的封装设计工程师、系统硬件工程师、信号完整性工程师,电路板设计工程师或有志于日后从事电子封装设计工作的大学生、研究生、企业工程师、封装厂与材料设备厂的前道或后道工艺与制程的工程师等,提供系统的从基础到深入实践的封装选型、基板设计规则、封装设计流程,结合实际封装设计项目案例,让学员快速掌握各种封装类型(包括Leadframe、FBGA、PBGA、SiP、FCCSP、FCBGA、PoP、PiP、Fan-in/Fan-out WLP、Hybird BGA)以及常见基板工艺与制程(ETS、Die attach、Wire bonding、RDL、TCNCP、TCB、 MEP、LSC、BOL、Mask、Bumping)等方面的知识和技能。

通过对这些技术问题的深入讨论与适用技能培训,将有助于快速提升工程师或相关技术人员的封装设计规则、设计流程、封装设计EDA软件、低成本与高性能封装的设计经验,以利于在实际设计中加快设计,避免可能出现的相关问题,确保最终电子产品的电热性能与可靠性,提升企业产品的竞争力。同时主办方将建立芯片封装设计技术交流群,以利于促进电子产品系统厂商、集成电路与半导体产业生态圈的同行之间更好地合作与交流。通过对这些技术问题的深入讨论与适用技能培训,将有助于快速提升工程师或相关技术人员的封装设计规则、设计流程、封装设计EDA软件、低成本与高性能封装的设计经验,以利于在实际设计中加快设计,避免可能出现的相关问题,确保最终电子产品的电热性能与可靠性,提升企业产品的竞争力。

   课程目标和收获

课程介绍

所谓“封装技术”是一种将集成电路用绝缘的塑料或陶瓷材料打包的技术。封装也是半导体集成电路芯片的外壳,它不仅起着安放、固定、密封、保护芯片和增强导热性能的作用,而且还是沟通芯片内部世界与外部电路的桥梁-芯片上的接点/IO PAD用键合线(Bonding Wire)连接到封装外壳的引脚或通过凸块(Bump)直接将芯片与封装基板连接,再扇出走线Fan-out到焊球,这些芯片引脚或封装焊球Solder Ball又通过印刷电路板上的导线与其他器件建立连接。因此,对于集成电路产品而言,封装技术都是非常关键的一环,封装决定了芯片与系统互连的电性能以及芯片散热性能。封装的选型,封装结构设计与基板设计决定了封装的成本与封装的电性能。基于此,本课程旨在为芯片设计公司或封装厂的培养芯片封装设计类专业技术人才。

倒装芯片(Flip-chip IC)封装技术,不但能够满足芯片大量(High Pin-Count)与高密度(High-Density) I/O Pad的扇出(Fanout)要求,而且凸块(Bump)由于其优越的导电性能与热传导性能,为芯片-封装-系统的互连提供了低电感、低电阻的信号与电源地回流路径、供电网络以及优良的散热性能等它可以提供更好的供电性能,目前已经在手机基带、应用处理器、网络处理器、数字机顶盒等芯片中得到了大量的应用,该封装工艺在国内与国际的封装厂都已经成熟与主流的芯片封装技术,也是芯片设计公司在规划先进节点工艺(90nm、65nm、40nm、28nm、16nm、14nm、10nm、7nm等)的芯片设计时考虑的首选封装技术。

本课程将介绍常见封装的种类、封装选型的策略、封装制造工艺、封装基板的设计工艺与各种低成本高性能封装(FO-WLP/PoP/SiP/ETS等)的设计规则、指南与案例分析;

本课程不仅能让初学者有一个对芯片封装从基础理论到实践操作全面的理解与掌握,同时也为现有从事芯片封装设计的工程师,提供一个学习最新设计方法与技能的机会。

   课程大纲
芯片封装基板设计培训班
第一阶段 理论与方法学集中授课

 

 

系统讲授封装基板材料、制造工艺、设计规则以及业界主流的封装类型的设计方法与流程,Cadence封装设计工具 APD/SiP Layout的应用,低成本与高性能封装设计案例与项目经验分享。

1、Major Package types and Assembly Process Introduction(主流封装类型以及制造工艺的介绍 )

导线架封装结构与工艺(Leadframe/QFP/MIS/QFN/FC-QFN/SOIC/DIP);

Wire bond 封装结构与工艺(CSP/FBGA/PBGA/EDHS-PBGA);

Flip-chip倒封装结构与工艺(FCCSP/FCBGA/FCBGA-OPL);

系统级封装与混合封装(SiP/Hybrid BGA);

晶圆级封装(Fan-in WLP/Fan-out WLP/eWLB);

高级封装与立体三维封装(PoP/PiP/2.5D interposer)

2、Introduction to Substrate(封装基板的简介)

什么是封装基板 (What is Substrate );

常见的封装基板制造工艺 (Substrate MFG Process-Tenting/SAP/mSAP);

封装基板的结构(Substrate Structure);

封装基板的表面处理(Substrate Surface Finish);

封装基板的原材料(Substrate Raw Material)

3、Bonding Wire Types、Performance and Selection(键合线的种类、性能与选择)

键合铜线 Copper Wire;

键合金丝/金线 Gold Wire;

键合银线 Silver Wire;

合金丝/银合金线 (Alloy Wire);

镀金银丝;

镀钯铜丝;

镀金钯铜丝;

金合金丝

4、Bumping Technology and Process Introduction(凸块技术与工艺介绍)

Printed/Plated Bump;

铜柱凸块 (Copper Pillar Bump);

锡铅凸块(Solder Bump /Eutectic Bump/HL);

环保型凸块(SnCu/SnAgCu-SAC/SnAg/HF);

凸块底部金属化(Under Bump Metallurgy-UBM);

重新分布层(Redistribution Layer-RDL: Al/NiV/Cu Au Al);

PI/RePSV/BCB/PBO/FOC

5.SiP Design Rule, Guideline and Case Study(系统级封装的设计规则/指南与案例分析)

基板叠层结构/PP/Core材料的选择;

系统级封装的原理图设计(Die /Passives符号建库与原理图设计);

网表输出与Die/IPD/Passives等器件摆放与布局;

系统级封装的设计规则;

物理规则设置(线宽/间距/过孔);

电气规则设置(阻抗/差分对/长度/Skew);

信号完整性/电源完整性/散热与机械应力的考虑;

数字/模拟/射频的隔离Isolation/Shielding;

Wire bond Profile模型设置;

布线与DRC/SRC规则检查;

基带与射频模块SiP设计案例讲解与演示

6. PoP Design Rule, Guideline and Case Study(PoP封装的设计规则/指南与案例分析)

基板叠层结构/PP/Core材料的选择;

Top Package/Bottom Package Ball Map的设计;

PoP封装的设计规则;

物理规则设置(线宽/间距/过孔);

电气规则设置(阻抗/差分对/长度/Skew);

信号完整性(eMMC/LPDDR3/LPDDR4/MIPI);

电源完整性/散热与机械应力的考虑;

Bump Pad/Bump Pitch/BOL走线;

布线与DRC/SRC规则检查;

高性能应用处理器PoP设计案例讲解与演示

7. Fan-out WLP Design Rule, Guideline and Case Study(Fan-out WLP封装的设计规则/指南与案例分析)

RDL 的走线规则 (in-chip /off-chip);

Fan-out WLP封装的设计规则;

物理规则设置(线宽/间距/过孔);

电气规则设置(阻抗/差分对/长度/Skew);

信号完整性;

电源完整性/散热与机械应力的考虑;

Bump Pad/Bump Pitch/BOL走线;

布线与DRC/SRC规则检查;

电源管理芯片PMIC Fan-out WLP设计案例讲解与演示

8、FCCSP Design Rule, Guideline and Case Study(FCCSP封装的设计规则/指南与案例分析)

基板叠层结构/PP/Core材料的选择;

低成本ETS/Coreless基板的设计规则;

物理规则设置(线宽/间距/过孔);

电气规则设置(阻抗/差分对/长度/Skew);

信号完整性/电源完整性/散热与机械应力的考虑;

Bump Pad/Bump Pitch/BOL走线;

布线与DRC/SRC规则检查;

消费类应用处理器 FCCSP设计案例讲解与演示

9、FBGA Design Rule, Guideline and Case Study(FBGA封装的设计规则/指南与案例分析)

基板叠层结构/材料;

物理规则设置(线宽/间距/过孔);

电气规则设置(阻抗/差分对/长度/Skew);

Bond wire Profile 模型设置;

布线与DRC/SRC规则检查;

FBGA设计案例讲解与演示;

10、PBGA Design Rule, Guideline and Case Study(PBGA封装的设计规则/指南与案例分析)

基板叠层结构/材料;

物理规则设置(线宽/间距/过孔);

电气规则设置(阻抗/差分对/长度/Skew);

Bond wire Profile 模型设置;

布线与DRC/SRC规则检查;

PBGA设计案例讲解与演示(Pin-gate/Mold-gate)

11、CPU Processor FCBGA Design Rule, Guideline and Case Study(FCBGA封装的设计规则/指南与案例分析)

基板叠层结构/PP/Core材料的选择;

FCBGA基板的设计规则;

物理规则设置(线宽/间距/过孔);

电气规则设置(阻抗/差分对/长度/Skew);

信号完整性(HyperTransport/DDR2/PCI/LPC/UART/SPI);

电源完整性/散热与机械应力的考虑;

Bump Pad/Bump Pitch/BOL走线;

布线与DRC/SRC规则检查;

嵌入式CPU处理器 FCBGA设计案例讲解与演示

12.High-Speed/High Power FCBGA Design Rule, Guideline and Case Study(高速网络处理器FCBGA 封装的设计规则/指南与案例分析)

基板叠层结构/PP/Core材料的选择;

高速与高功耗基板的设计规则;

物理规则设置(线宽/间距/过孔);

电气规则设置(阻抗/差分对/长度/Skew);

信号完整性(10Gbps /28Gbps SerDes /Multi-channel DDR3/DDR4);

电源完整性/散热与机械应力的考虑;

Bump Pad/Bump Pitch/BOL走线;

布线与DRC/SRC规则检查;

高速网络处理器Networking Processor FCBGA设计案例讲解与演示

13. Multi-Stackup MCM Package Design Rule, Guideline and Case Study

(多层堆叠的多芯片模块封装的设计规则/指南与案例分析)

多层堆叠封装的设计规则;

Die 厚度与DA Film的材料与厚度选择;

多颗Die堆叠SiP的布局Placement/DFA;

多层堆叠的多芯片模块封装的设计案例讲解与演示

第二阶段 项目案例实训

学员根据项目要求,EDA软件(Cadence APD/SiP Layout ,Autodesk Autocad软件)及封装项目数据database,完成实训项目案例从项目-Die Coordinate 文件、BGA与Die互连网表、叠层结构Stackup到走线线宽与间距规则设计、Ball Map、Die PAD、Bump Cell PAD/UBM、RDL、ETS、THR、HDI、BOL等,设计规则检查DRC/ERC等,涉及的EDA工具(Cadence APD/SiP/Autodesk AutoCad)与实训项目如下:

a)Wire Bond Package(CSP/BGA/SiP):

1. FBGA/CSP

2. PBGA

3. SiP (Passives+ Dies)

4. MCM (Stackup Dies)

b) WLP/eWLB (Wafer Level Package):

1. Fan-in WLP (wi/wo RDL)

2. Fan-out WLP (wi RDL)

c) fcCSP/fcBGA/PoP:

1. fcCSP (ETS/Coreless)

2. fcBGA (THR/HDI 1-2-1/2-2-2/3-2-3/4-2-4)

3. PoP (dual-channel /Single –channel LPDDR3/LPDDR4)

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.(2014年7月11).........................................................

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